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2015-11-20 14:05
CPLD VHDL 如何在一个时钟周期的低电平期间产生多个脉冲?
CPLD VHDL中一般都是在有高频时钟输入时,用计数的方式产生分频信号,我现在是要一个频率约为2HZ时钟信号的低电平期间产生多个脉冲,比如2000个,有点类似于单片机中低电平片选……
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2015-11-11 09:08
RE: 《FPGA应用开发入门与典型实例》(修订版)——FPGA电子书分享
怎下不了? ……
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2015-11-10 23:06
RE: (电子书)Altera FPGA设计(高级篇)
求怎么解压……
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2015-11-10 23:03
RE: (电子书)Altera FPGA设计(高级篇)
我将这5 个部分都下下来了,解压不了呀,……
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2015-11-10 22:43
RE: (电子书)Altera FPGA设计(高级篇)
好 得很,多多益善……
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2015-11-10 19:51
RE: FPGA开发讲座3:使用FPGA的开发工具(共4讲)(ppt)
学习学习……
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2015-11-10 19:15
RE: 在QuartusII中利用免费IP核的设计
学习……
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2015-11-10 18:59
RE: VHDL实用教程(潘松的,经典教程,电子书,非扫描版)
这个书很有下一下的必要……
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2015-11-10 18:56
RE: 转发“华为内部的Quartus教程”
好得……
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2015-11-10 18:47
RE: 《FPGA/CPLD应用设计200例》---精通这些例程,你就是专家了
如何下载下来学习一下子呢?……
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