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Verilog HDL基础知识9之代码规范

2024-02-26

1.RTL CODE 规范1.1标准的文件头在每一个版块的开头一定要使用统一的文件头，其中包括作者名，模块名，创建日期，概要，更改记录，版权等必要信息。统一使用以下的文件头：其中*为必需的项目//***********......

FPGA verilog HDL 代码规范

Verilog HDL基础知识8之综合语句

2024-02-22

可综合语句1.要保证Verilog HDL赋值语句的可综合性，在建模时应注意以下要点：2.不使用initial。3.不使用#10。4.不使用循环次数不确定的循环语句，如forever、while等。5.不使用用户自定义原......

FPGA verilog HDL 综合语句

Microchip推出低成本PolarFire SoC Discovery工具包加速RISC-V和FPGA设计

2024-02-21

嵌入式行业对基于RISC-V®的开源处理器架构的需求日益增长，但在商用芯片或硬件方面的选择仍然有限。为了填补这一空白并推动创新，Microchip Technology Inc.（微芯科技公司）宣布推出PolarFire......

Microchip PolarFire 嵌入式系统工程师 RISC-V FPGA

Verilog HDL基础知识7之模块例化

2024-02-21

Verilog使用模块（module）的概念来代表一个基本的功能块。一个模块可以是一个元件，也可以是低层次模块的组合。常用的设计方法是使用元件构建在设计中多个地方使用的功能块，以便进行代码重用。模块通过接口（输入和输出）......

FPGA verilog HDL 模块例化

Verilog HDL基础知识6之语法结构

2024-02-21

虽然 Verilog 硬件描述语言有很完整的语法结构和系统，这些语法结构的应用给设计描述带来很多方便。但是 Verilog是描述硬件电路的，它是建立在硬件电路的基础上的。有些语法结构是不能与实际硬件电路对应起来的，比如 ......

FPGA verilog HDL 语法结构

英特尔FPGA Vision线上研讨会亮点抢先看

2024-02-20

继宣布将可编程解决方案事业部 (PSG) 作为独立业务部门运营后，英特尔将于3月1日举行FPGA Vision线上研讨会。届时，首席执行官Sandra Rivera和首席运营官Shannon Poulin将分享有关全新企......

英特尔 FPGA

Verilog HDL基础知识4之阻塞赋值 & 非阻塞赋值

2024-02-20

阻塞赋值语句串行块语句中的阻塞赋值语句按顺序执行，它不会阻塞其后并行块中语句的执行。阻塞赋值语句使用“=”作为赋值符。例子阻塞赋值语句 reg x, y, z; reg [15:0......

FPGA verilog HDL 阻塞赋值非阻塞赋值

Verilog HDL基础知识4之wire & reg

2024-02-20

简单来说硬件描述语言有两种用途：1、仿真，2、综合。对于wire和reg，也要从这两个角度来考虑。\从仿真的角度来说，HDL语言面对的是编译器（如Modelsim等），相当于软件思路。这时： wire对应于连续赋值，如......

FPGA verilog HDL wire reg

利用FPGA进行基本运算及特殊函数定点运算

2024-02-19

一、前言　　FPGA以擅长高速并行数据处理而闻名，从有线/无线通信到图像处理中各种DSP算法，再到现今火爆的AI应用，都离不开卷积、滤波、变换等基本的数学运算。但由于FPGA的硬件结构和开发特性使得其对很多算法不友好，之......

FPGA 数学运算

FPGA内部自复位电路设计方案

2024-02-19

1、定义　　复位信号是一个脉冲信号，它会使设计的电路进入设定的初始化状态，一般它作用于寄存器，使寄存器初始化为设定值；其脉冲有效时间长度必须大于信号到达寄存器的时延，这样才有可能保证复位的可靠性。　　下面将讨论FPGA/......

FPGA 复位电路

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