共2条
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Digital,nbsp,nbsp,IC,nbsp,nbsp,Design,nbsp,nbsp,t Digital IC &nb
问
数字集成电路前端设计就业班
招 生 简 章
服务特色
一流的学习环境：设施一流的培训机房及听课教室，配置有数十台高配置电脑、教学用多媒体软件、投影仪及其他相应的先进教学设备。
一流的实验环境：当今主流EDA工具提供商的各种IC设计软件和高档工作站和服务器，保证了充足的工具使用。
一流的讲师资源：来自各重点院校的优秀讲师及IC企业的资深技术经理。他们拥有丰富的实践经验，提供给学员第一手的设计经验。
实用的课程设置：整个课程由实践项目贯穿始终，学员在实践中学习、成长。理论知识、先进技术的完美结合。有充足的上机练习保证。
严格的教学管理：科学的学前测试，根据学员的实际水平推荐合适的课程。模块化教学增加更多选择。严格的考核制度，结业考试成绩优异者将获得奖学金并优先向园区企业推荐。
专业的就业推荐：丰富的IC客户资源、第一手的IC企业招聘信息，会及时反馈给学员。为合格学员争取更多的面试机会。
讲师介绍
张学鹏，现任北京华大信安科技有限公司副总经理。毕业于清华大学无线电系微电子学专业，硕士毕业于中国科学院半导体研究所，导师：王守觉院士。从事微电子行业近二十年来曾在中科院半导体研究所、中科院自动化研究所国家集成电路工程中心、Synopsys北京办事处、Tektronix (中国)任职，在北京太平洋连宇通信公司任ASIC技术总监，北京天一集成科技有限公司任董事、总工程师。
招生对象
电子类相关专业本科、硕士在读生、毕业生，包括在职工程师、高校任课教师以及相关专业背景、符合报名要求的、有志于在IC设计行业发展的其他人员。
报名要求
有数字电路设计、C语言程序设计的基础或自学过相关课程。
现场报名时免费提供测试机会，并针对知识的薄弱环节提供专业的技术指导。
培训目标
通过课程学习和课程实践，学会综合运用数字逻辑、VLSI电路设计、硬件描述语言，进行数字电路设计的方法，达到能独立设计完成中等规模模块的前端设计水平。
课程说明
本课程分为四大部分：数字电路逻辑设计、Verilog语言及其综合、VLSI电路设计实例、上机实验。本课程根据教学需要由浅入深，有机地将四部分穿插进行，更有利于学员理解数字集成电路前端设计中的概念及设计思想，达到融会贯通的目的。
一、数字电路逻辑设计部分包含组合电路分析与设计、时序电路分析与设计、可编程逻辑器件。
二、Verilog语言及其综合部分包括全面讲解Verilog语言的语法、深入讲解Verilog仿真机理、各种典型结构的描述方法、仿真模型的建立方法，可综合子集、综合概念、机理及综合后分析、优化。
三、VLSI电路设计实例包括各种加法器、乘法器、除法器、状态机、总线仿真模型、总线接口电路、RISC CPU、FIR滤波器。
四、上机实验部分包括UNIX操作系统、NC-Verilog Design Compiler等EDA工具的使用，仿真调试技巧练习，完整的设计实例的仿真、综合、分析、优化过程。
设计实例
本设计项目是构造一个8 阶低通FIR 滤波器，每一级都保存了一个经过延时的输入样值，各级的输入连接和输出连接被称为抽头。一个M 阶的FIR 滤波器将有M+1个抽头。通过移位寄存器用每个时钟边沿n（时间下标）处的数据流采样值乘以抽头系数，并将它们加起来形成输出。
免费培训
上课期间免费提供Verification with VCS 培训，由Synopsys资深工程师亲自授课，并使用Synopsys专门教材，按要求完成所有的实验操作，培训结束颁发Synopsys公司签发的结业证书。共3天课程，价值2400元。
课程长度
110学时，课程设置以讲解设计方法、设计实例和上机实践设计项目为主。
开课时间
2006年9月28日，共10周课。
上课时间
每周二晚上18：30-21：00 每周六上午9：00-12：00，下午13：00-17：00
学习费用
报名费：100元 学 费：4800元，包括听课、讲义、上机辅导、上机实验、证书等
优惠政策
2006年9月20日前报名免收报名费 报名截止日期9月25日
在校生凭学生证可享受优惠价4200元，5人以上团体报名可享受优惠价4000元
社会人员、在职工程师5人以上团体报名可享受优惠价4600元
奖学金政策
在结业考试中成绩位于前3名的学员可享受设计园的优等奖学金和成功就业奖学金。
免费试听
上课期间，凡有愿意了解本培训相关情况者，可报名参加免费试听，与正式学员同堂听课，感受IC设计的学习氛围。试听次数限每人一次，时长三学时。
联系方式
联系电话：010-82351166 87239511（移动） 传 真：010-82357178
E - mail：ictrain@bjicpark.com 网 址：www.bjicpark.com
注：本班限招人数20人，名额有限，欲报从速！若报名人数少于10人则不开班。
点击http://www.bjicpark.com/jqpx68.htm查看课程大纲
点击http://www.bjicpark.com/jqpx68_1.htm查看讲师其他详细介绍
点击http://www.bjicpark.com/jqpx72.htm查看北京集成电路设计园奖学金政策
点击http://www.bjicpark.com/jqpx67.htm下载报名回执
答 1: 修改了一下赠送了一个VCS工具培训 答 2: 此班已经开课上课期间欢迎感兴趣的工程师前来试听
老师将会用5种设计方法来设计同一个项目，实用性非常强，同时可以了解市场需求方向，机会不容错过呀！！
招 生 简 章
服务特色
一流的学习环境：设施一流的培训机房及听课教室，配置有数十台高配置电脑、教学用多媒体软件、投影仪及其他相应的先进教学设备。
一流的实验环境：当今主流EDA工具提供商的各种IC设计软件和高档工作站和服务器，保证了充足的工具使用。
一流的讲师资源：来自各重点院校的优秀讲师及IC企业的资深技术经理。他们拥有丰富的实践经验，提供给学员第一手的设计经验。
实用的课程设置：整个课程由实践项目贯穿始终，学员在实践中学习、成长。理论知识、先进技术的完美结合。有充足的上机练习保证。
严格的教学管理：科学的学前测试，根据学员的实际水平推荐合适的课程。模块化教学增加更多选择。严格的考核制度，结业考试成绩优异者将获得奖学金并优先向园区企业推荐。
专业的就业推荐：丰富的IC客户资源、第一手的IC企业招聘信息，会及时反馈给学员。为合格学员争取更多的面试机会。
讲师介绍
张学鹏，现任北京华大信安科技有限公司副总经理。毕业于清华大学无线电系微电子学专业，硕士毕业于中国科学院半导体研究所，导师：王守觉院士。从事微电子行业近二十年来曾在中科院半导体研究所、中科院自动化研究所国家集成电路工程中心、Synopsys北京办事处、Tektronix (中国)任职，在北京太平洋连宇通信公司任ASIC技术总监，北京天一集成科技有限公司任董事、总工程师。
招生对象
电子类相关专业本科、硕士在读生、毕业生，包括在职工程师、高校任课教师以及相关专业背景、符合报名要求的、有志于在IC设计行业发展的其他人员。
报名要求
有数字电路设计、C语言程序设计的基础或自学过相关课程。
现场报名时免费提供测试机会，并针对知识的薄弱环节提供专业的技术指导。
培训目标
通过课程学习和课程实践，学会综合运用数字逻辑、VLSI电路设计、硬件描述语言，进行数字电路设计的方法，达到能独立设计完成中等规模模块的前端设计水平。
课程说明
本课程分为四大部分：数字电路逻辑设计、Verilog语言及其综合、VLSI电路设计实例、上机实验。本课程根据教学需要由浅入深，有机地将四部分穿插进行，更有利于学员理解数字集成电路前端设计中的概念及设计思想，达到融会贯通的目的。
一、数字电路逻辑设计部分包含组合电路分析与设计、时序电路分析与设计、可编程逻辑器件。
二、Verilog语言及其综合部分包括全面讲解Verilog语言的语法、深入讲解Verilog仿真机理、各种典型结构的描述方法、仿真模型的建立方法，可综合子集、综合概念、机理及综合后分析、优化。
三、VLSI电路设计实例包括各种加法器、乘法器、除法器、状态机、总线仿真模型、总线接口电路、RISC CPU、FIR滤波器。
四、上机实验部分包括UNIX操作系统、NC-Verilog Design Compiler等EDA工具的使用，仿真调试技巧练习，完整的设计实例的仿真、综合、分析、优化过程。
设计实例
本设计项目是构造一个8 阶低通FIR 滤波器，每一级都保存了一个经过延时的输入样值，各级的输入连接和输出连接被称为抽头。一个M 阶的FIR 滤波器将有M+1个抽头。通过移位寄存器用每个时钟边沿n（时间下标）处的数据流采样值乘以抽头系数，并将它们加起来形成输出。
免费培训
上课期间免费提供Verification with VCS 培训，由Synopsys资深工程师亲自授课，并使用Synopsys专门教材，按要求完成所有的实验操作，培训结束颁发Synopsys公司签发的结业证书。共3天课程，价值2400元。
课程长度
110学时，课程设置以讲解设计方法、设计实例和上机实践设计项目为主。
开课时间
2006年9月28日，共10周课。
上课时间
每周二晚上18：30-21：00 每周六上午9：00-12：00，下午13：00-17：00
学习费用
报名费：100元 学 费：4800元，包括听课、讲义、上机辅导、上机实验、证书等
优惠政策
2006年9月20日前报名免收报名费 报名截止日期9月25日
在校生凭学生证可享受优惠价4200元，5人以上团体报名可享受优惠价4000元
社会人员、在职工程师5人以上团体报名可享受优惠价4600元
奖学金政策
在结业考试中成绩位于前3名的学员可享受设计园的优等奖学金和成功就业奖学金。
免费试听
上课期间，凡有愿意了解本培训相关情况者，可报名参加免费试听，与正式学员同堂听课，感受IC设计的学习氛围。试听次数限每人一次，时长三学时。
联系方式
联系电话：010-82351166 87239511（移动） 传 真：010-82357178
E - mail：ictrain@bjicpark.com 网 址：www.bjicpark.com
注：本班限招人数20人，名额有限，欲报从速！若报名人数少于10人则不开班。
点击http://www.bjicpark.com/jqpx68.htm查看课程大纲
点击http://www.bjicpark.com/jqpx68_1.htm查看讲师其他详细介绍
点击http://www.bjicpark.com/jqpx72.htm查看北京集成电路设计园奖学金政策
点击http://www.bjicpark.com/jqpx67.htm下载报名回执
答 1: 修改了一下赠送了一个VCS工具培训 答 2: 此班已经开课上课期间欢迎感兴趣的工程师前来试听
老师将会用5种设计方法来设计同一个项目，实用性非常强，同时可以了解市场需求方向，机会不容错过呀！！
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